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我国科学家造出可编程三维光子神经网络

我国科学家造出可编程三维光子神经网络

将可编程光子神经网络写进玻璃内部，是不是听上去有些科幻？科学家近期的一项研究证明，这条路不仅跑通了，而且规模越大优势越明显。近期，华中科技大学张新亮教授、董建绩教授与上海交通大学唐豪教授团队联合提出了一种可编程光子计算的新范式。他们开发了新架构 LAMP（Lantern-shaped Adaptive Multilayer Photonic network），意为灯笼形自适应多层光子网络。

Altera重出江湖加强5G物联网市场布局

3月1日，英特尔宣布成立全新独立运营的FPGA公司Altera。这家新公司由首席执行官Sandra Rivera领导，她表示，Altera的解决方案专为包括网络、通信基础设施、低功耗嵌入式等在内的广泛市场和实践应用而优化。英特尔此次成立独立运营的FPGA公司，旨在更好地满足市场需求，提供更专业的服务。FPGA（现场可编程门阵列）技术在许多领域都有广泛的应用，包括数据中心、汽车、5G通信等。Altera作为英特尔旗下的全新独立运营公司，将专注于开发和优化FPGA解决方案，以满足各种市场需求。此次成立新公司的举措，显示出英特尔对于FPGA技术的重视，以及对于未来市场发展的积极布局。随着5G、物联网等技术的不断发展，FPGA技术的应用前景将更加广阔。英特尔通过成立Altera公司，有望进一步巩固在FPGA领域的领先地位，为各行业提供更加专业和高效的解决方案。

發表于：2024/3/4

Cirrus Logic、英特尔和微软联手推出全新参考设计

　　美国德克萨斯州奥斯汀，2024年2月22日-- Cirrus Logic （纳斯达克代码：CRUS）近日宣布与英特尔和微软在全新的PC参考设计上进行合作。该设计将采用Cirrus Logic的高性能音频和电源技术以及英特尔即将推出的代码为Lunar Lake的客户端处理器。除了为笔记本电脑创造更丰富、更沉浸式的音频体验外，此次合作还将减少发热，延长电池寿命，并实现更小、更轻薄的设计。

發表于：2024/2/26

道路平整度检测多源数据高精度同步采集

随着使用年限增加，道路出现了不平整等路面损坏情况，急需一种快速、有效的道路平整度检测设备对道路进行检测。设计了一种道路平整度检测多传感器数据同步采集系统，以FPGA为控制核心，利用GPS输出的NEMA数据和高稳晶振建立高精度的时间基准，采用A/D采样的方式进行同步数据采集。为提高系统的抗干扰能力和数据采样的精度，传感器信号调理电路采用差分放大和抗混叠滤波设计。实验结果表明，该系统完成了多传感器数据高精度同步采集，时间同步精度为微秒级，能够为评价路面平整度提供高精度原始数据，具有数据采样精度高、稳定性好、抗干扰能力强、成本低等优点，已在武汉夕睿光电技术有限公司的道路检测车上得到成功应用。

發表于：2024/2/21

一种基于FPGA的eMMC寿命验证的方法

为满足测试eMMC存储颗粒的长时间读写性能要求，研究了一种基于FPGA的eMMC寿命验证方法。结合eMMC工作原理和High Speed DDR（双倍率）总线模式，详细设计出验证系统的核心组成部分。硬件采用FPGA（xc7a50tfgg484-1）芯片作为主控器，4片eMMC（FEMDRW064G-88A19）芯片作为验证对象。解析eMMC初始化配置方法，设计开放式读写模块，配合eMMC监控软件控制指令，完成4片180 000次块区域的循环读写，测试结果全部通过，读写均速达到31 MB/s。

發表于：2024/2/21

低成本惯性多冗余导航控制一体机设计

为了智能体的精确定位和定姿，实现其稳定运动控制，设计了一种低成本多惯性冗余导航控制一体机，给出了设计方法。稳压电路的开关电源MP2482DN和线性电源JW29300U-3.3V为一体机提供稳定5 V和3.3 V的较大功率电源；控制器STM32H7的SPI采用星形拓扑总线与3片六轴惯性芯片BMI088通信，2路TTL串口与差分卫星定位板双向通信，实现智能体定位和定姿；控制器STM32F4的CAN总线接口与智能体底盘双向通信，实现其运动控制，1路TTL串口实现与控制器STM32H7的双向通信；两控制器的网络接口与上位机组成无线局域网，实现数据交换和状态监控。整个系统具有功耗低、体积小、成本低、接口丰富的特点。

發表于：2024/2/21

基于FPGA的高速模数转换器评估系统

设计并验证了一种基于现场可编程逻辑阵列（FPGA）的高速模数转换器（ADC）评估系统。基于FPGA设计了底层逻辑，根据不同的测试指标控制ADC的信号采集和数据转换，将模拟输入信号转换为数据存储到FPGA的分布式存储器（Block RAM）中，通过用户数据报协议（UDP）将数据传输到电脑端的基于MATLAB开发的上位机，由电脑中央处理器（CPU）负责处理计算数据并输出测试结果到用户界面上。以一款16位、采样率100 MS/s的ADC为例，以该评估系统对ADC的各项参数指标进行测试和分析。实验结果表明，该系统可以实现高速、高精度ADC的测试和评估。

發表于：2024/2/21

一种基于异构处理器的可动态布署设计与实现

针对卫星支持的多种生活服务需求实时切换、资源灵活智能调用需求，基于无线广域信号服务异构处理器，设计了一种即时高效、动态切换部署处理器功能的方案。通过对大资源FPGA及多片8核DSP多种功能定制结合动态部署设计，实现实时动态可重构处理器系统功能，将5种FPGA应用结合2种DSP应用程序动态组合，配合各功能任务架构需求重建控制、数据链路，完成多任务智能切换。

發表于：2024/2/20

工控网络安全靶场异构资源建模封装技术研究

针对工控网络安全靶场的异构资源种类多、管控难的问题，采用元建模的方式对各类试验资源进行建模，分类并统一描述真实资源的功能、性能、接口、形态等属性，建立与真实资源映射的模型，实现模型复用、快速重构；分析资源的管控接口、采集接口和I/O接口，建立资源构件化封装规范，对各类资源进行构件化封装，为工控网络安全靶场资源的灵活配置、自动管控提供技术支撑。通过软件工具对资源建模封装的方法进行了验证。该研究的意义在于通过建模封装技术，实现对资源的可视化操作和统一管理。

發表于：2024/2/20

基于流水线的RSA加密算法硬件实现

针对硬件实现高位RSA加密算法成本比较高的问题，在传统的基4蒙哥马利（Montgomery）算法上进行改进。首先引入CSA加法器快速完成大数的加法计算；然后在后处理上做优化，以减少每次蒙哥马利计算的大数个数；最后在计算RSA加密算法时加入了流水线，在并行执行RSA加密的条件下降低硬件资源的使用。在Xilinx XC7K410T系列的FPGA开发板上的实验结果表明，在保证加密速率的前提下，改进的RSA加密算法结构使用的硬件资源是原来并行结构的1/2，而且可以在更高的频率下工作。

發表于：2024/2/20

基于FPGA的晶圆级芯片封装图像序列配准方法的设计与实现*

针对未切割晶圆进行封装后的晶圆级芯片封装（WLCSP），12英寸晶圆以1 μm物理分辨率进行自动光学检测（AOI）面临大幅面、高质量成像和成像速度的技术挑战。晶圆全局图像需由多幅扫描生成的局部图像序列拼接而成，为实现图像序列的高质量、高速配准，在FPGA中采用OpenCL实现相位相关法进行四邻域棋盘配准。首先在构建二维FFT和互功率谱函数内核的基础上，采用双端口缓存和行缓存的设备全局内存对计算过程的频谱数据进行复用并应用内核通道级联提高配准速度，基于最小生成树优化配准结果降低全局图像坐标计算的累积误差，并经实际扫描图像验证配准算法及加速性能。关键词：晶圆级芯片封装；图像配准；FPGA；OpenCL

發表于：2024/1/26

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