頭條 世界首款微处理器MP944被复活 7月27日，嵌入式系统专家亚当·泰勒使用FPGA（现场可编程门阵列）复刻F-14雄猫战斗机的中央大气数据计算机，将其装入3D打印的F-14模型中，成功控制后者的可变后掠翼系统。 该系统核心为MP944微处理器，1970年6月随F-14服役，比1971年11月问世的英特尔4004早近一年半，此前因军事保密1998年才解密，是世界首款微处理器，性能较英特尔4004快约8倍。亚当·泰勒基于Spartan 7的SoM模块复现了MP944全部六块芯片，目前该项目的全部代码和文档已公开在GitHub，供全球开发者查阅。 最新資訊 基于CPLD器件在时间统一系统中的应用 随着电子技术的发展，对遥测信号的帧结构的可编程度、集成度的要求越来越高，用于时间统一系统的B码源的设计也趋于高度集成化。为了适应现代靶场试验任务的要求，我们采用Altera的CPLD器件，将用于产生B码的各种门电路集成在一个芯片，通过高度集成的系统可以用于产生标准的串行时间码向测量设备发送，测量设备对接收到的B码进行解调能产生出系统所需的绝对时间和各种控制信号。此B码产生系统可作为基地设备检测调试用，也可作实践教学设备。 發表于：2010/3/17 JPEG2000 MQ编码器的设计与实现 提出了一种JPEG2000 MQ编码器的硬件设计方案。通过状态更新超前预测、前导零检测、重归一化超前预测等方法以及字节输出的改进处理，使MQ编码器的工作速率可达1CxD/cycle。同时对各流水段中的路径进行优化改进，提高了系统的最高时钟频率。采用Verilog语言进行RTL级描述，并在Altera的FPGA上进行了仿真验证。结果表明，在Altera的EP2S60F67214上，该MQ编码器的最高工作时钟频率可达65.19 MHz。 發表于：2010/3/17 基于FPGA的永磁同步电机控制器设计 提出一种基于FPGA的永磁同步电机控制器的设计方案，该设计可应用于具有高动态性能要求的永磁同步电机伺服控制系统。为提高伺服控制系统的实时性，简化电路及节省成本，该系统设计采用Ahera公司生产的CycloneIII EP3C25Q240C8型FPGA器件实现电机控制器。嵌入NiosⅡCPU软核配合片内硬件乘法器及可编程逻辑门阵列，实现软硬件协同工作。通过QuartusⅡ软件自带的SignalTaplI嵌入式逻辑分析仪进行板上调试验证，得到带有死区输出的PWM波形。该PWM波形可用于电机驱动。 發表于：2010/3/17 航空电子系统设计中FPGA技术的应用 现代FPGA的强大功能使其成为MIL-STD -1553设计的理想选择，这就是Condor Engineering推出FlightCORE的原因。FlightCORE是一种允许设计人员在各种Altera和Xilinx的FPGA中轻松实现无版权的实例化设计的MIL-STD-1553 IP。 發表于：2010/3/16 基于Verilog计算精度可调的整数除法器的设计 目前，实现除法器的方法有硬件实现和软件实现两种方法。硬件实现的方法主要是以硬件的消耗为代价，从而有实现速度快的特点。用硬件的方法来实现除法器的研究很多，如利用微处理器实现快速乘除法运算，FPGA实现二进制除法运算，模拟除法器等；而通过软件实现的除法器算法，可以大大提高器件的工作频率和设计的灵活性，可以从总体上提高设计性能，而设计高效实用的算法是除法器的关键，故除法器的算法研究成为现今热点。 發表于：2010/3/16 基于CPLD的曼彻斯特编码技术 研究了曼彻斯特编解码方法，采用VHDL语言在CPLD上实现了编解码，使系统的功能高度集成，提高了系统的灵活性与兼容性。通过MAX+PLUS II仿真了2 MB/s速率下的编解码，结果和理论分析一致，验证了编解码电路设计的有效性和可行性。 發表于：2010/3/15 基于速大容量存储系统设计 设计中相机输出LVDS串行数据通过接收电平转换和串并转换后得到10路×8 bit的并行数据流，其数据流速率最大为66 MHz。之后根据相机MC1311的性能指标可计算出Camera Link高速接口与数据存储系统的存储容量要求与存储速度要求，即：单帧数据量为1280×1024×8 bit；每秒最大数据量为500×1280×1024×8 bit；Camera Link高速接口单路数据速率为65.536 MByte，如果需要连续存储60秒的视频数据，则需要40 G Byte存储器容量。100 GByte的存储容量最多大约可存储2.5分钟视频数据。 發表于：2010/3/12 基于FPGA的一种新型8通道数据采集系统 以FPGA为核心控制模块，搭载MAX1300为数据采集模块，完成8通道、16位精度数据采集系统。采集数据在FPGA内部储存，DSP在适当时刻对其进行读取以完成伺服控制工作。针对以往数据采集系统的局限，FPGA内部对所采集数据进行预处理，减轻了CPU数据处理强度和负担。详细介绍了各芯片硬件电路设计，给出FPGA内部各功能模块逻辑图。 發表于：2010/3/11 三星电子和赛灵思共同宣布赛灵思45nm Spartan-6 FPGA 系列实现全面量产供货 全球高级半导体技术领先者三星电子有限公司和全球可编程逻辑解决方案领导厂商赛灵思公司（Xilinx, Inc. (NASDAQ: XLNX)）日前共同宣布，赛灵思 Spartan®-6 FPGA 系列已取得三星电子旗下晶圆代工厂三星代工（Samsung Foundry）的 45nm 工艺技术的全面生产认证。这种先进的工艺节点技术结合业界一流的 FPGA 设计，可实现低成本、低功耗、高性能的最佳平衡，从而使 Spartan-6 系列 FPGA 能够满足成本敏感型市场的各种应用需求。今天发布的消息标志着在三星代工制造的赛灵思45nm Spartan-6 FPGA 系列已经能够立即实现量产供货。 發表于：2010/3/11 基于SoC的音频IP模块设计 IP称之为知识产权，它可以认为是封装在硬件设计中的可重复利用的软件，就功能而言，IP核可以定义为SoC的基本电路功能块又称为内核，可由用户或专用IC公司或独立的公司开发而成，IP核的显著特点是具有重用性。鉴于SoC系统设计者很难独自开发、维护和移植所有必须的IP核，所以在Soc设计中必然要用到第3方的IP核，当IP核被转移到用户设计与制造工艺中时，IP核被重复利用了，具有自主知识产权的IP核的复用是Soc设计中解决设计层次、产品成本、设计周期和降低风险的关键环节是SoC设计中的关键技术。IP核重复利用可以提高设计能力，节省设计人员可以缩短上市时间，更好的利用现有的工艺技术，降低成本。基于此笔者设计了基于SoC的音频接口IP模块。 發表于：2010/3/11 <…482483484485486487488489490491…>
