| 基于FPGA的PN码捕获和跟踪技术的研究与实现 | |
| 所屬分類：参考设计 | |
| 上傳者：aet | |
| 文檔大小：381 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：研究了在直接序列扩频通信中基于FPGA的基带PN码（扩频码）的捕获跟踪技术。在PN码解调中，介绍了串并混合的捕获方案和基于迟早门的跟踪方案。以Quartus II作为平台采用Verilog HDL的硬件描述语言进行设计，并进行了Modelsim的仿真测试，最终下载到具体FPGA器件进行了基带的传输测试。 | |
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