| 基于CPLD的SGPIO总线实现及应用 | |
| 所屬分類：参考设计 | |
| 上傳者：aet | |
| 文檔大?。?span>372 K | |
| 標簽： CPLD | |
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| 文檔介紹：分析了SGPIO总线的数据传输机制，用CPLD模拟SGPIO总线协议来实现并行数据的串行传输，并将其与串并数据转换集成芯片进行对比，说明了前者的应用优势，并且指出了其应用场合。采用Lattice Diamond IDE进行了Verilog HDL代码编写和综合，并用ModelSim进行时序仿真，最终下载到CPLD器件进行测试。结果证明了采用CPLD实现SGPIO总线协议的可行性以及将其应用到板级之间数据通信的优越性。 | |
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