一种带Cache的嵌入式CPU的设计与实现
所屬分類：参考设计
上傳者：aet
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文檔介紹：基于FPGA平台实现了嵌入式RISC CPU的设计.根据项目要求,实现指令集为MIPS CPU指令集的一个子集,分析指令处理过程,构建了嵌入式CPU的5级数据通路.分析了流水线产生的相关性问题,采用数据前推技术和软件编译结合的解决方案.给出了控制单元,运算单元,指令Cache的实现与设计.在FPGA平台上实现并验证了CPU的设计.
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