一种基于插值算法符号同步的硬件设计
所屬分類：技术论文
上傳者：aet
文檔大小：246 K
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文檔介紹：提出了一种数字接收机中符号同步的硬件设计方案。该方案属于异步采样恢复法，其插值滤波器的设计采用了理想插值算法加窗处理，较传统的拉格朗日插值有更好的频域特性。该设计方案已用VerilogHDL实现，并通过了综合及时序验证。
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