| 一种新型的基于FPGA的SMS4密码算法电路设计 | |
| 所屬分類：参考设计 | |
| 上傳者：aet | |
| 文檔大小：2228 K | |
| 標簽： FPGA | |
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| 文檔介紹：提出了一种新型的基于FPGA硬件实现的SMS4分组密码算法电路的设计。相较于常用的流水线设计方法和迭代设计方法，此设计将流水线和迭代运算相结合，结合了前者较高处理速度和后者较小实现面积的优点，达到了较好的性能，对WLAN商用密码算法的FPGA硬件实现有参考意义。通过Quartus II 8.0软件时序仿真验证了此设计的正确性，并使用以Cyclone II FPGA芯片为核心的DE2开发板验证了此设计的可实现性。 | |
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