使用VHDL进行分频器设计
所屬分類：软件
上傳者：chenyy
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標簽： 开发工具
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文檔介紹：本文使用实例描述了在FPGA/CPLD上使用VHDL进行分频器设计，包括偶数分频、非50%占空比和50%占空比的奇数分频、半整数（N+0.5）分频、小数分频、分数分频以及积分分频。所有实现均可通过Synplify Pro或FPGA生产厂商的综合器进行综合，形成可使用的电路，并在ModelSim上进行验证。
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