| Virtex-5 HDL 设计指南 | |
| 所屬分類：参考设计 | |
| 上傳者：chenyy | |
| 文檔大小：3253 K | |
| 標(biāo)簽： FPGA | |
| 所需積分：0分積分不夠怎么辦？ | |
| 文檔介紹：针对Virtex-5 给出了HDL设计指南，其中，赛灵思为每个设计元素给出了四个设计方案元素，并给出了Xilinx认为是最适合你的解决方案。这4个方案包括：实例，推理，CORE Generator或者其他Wizards，宏支持. | |
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