基于FPGA的高速LDPC码编码器的设计与实现
所屬分類：参考设计
上傳者：chenyy
文檔大小：50 K
標簽： FPGA
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文檔介紹：LDPC码是通信系统中一种性能十分优秀的信道编码。本文针对便于硬件实现的QC_LDPC码进行了编码器设计，采用多路并行、流水线结构、优化关键路径等多种手段，在Altera公司FPGA平台上实现了编码速率高达1.6Gbps的编码器，并使用逻辑分析仪验证了编码器在高速运行下结果的正确性。
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