| 基于H.264帧间预测解码的研究及高效VLSI实现 | |
| 所屬分類：技术论文 | |
| 上傳者：aet | |
| 文檔大小：320 K | |
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| 文檔介紹：在深入研究H.264帧间预测技术的基础上，采用三级流水线实现帧间预测解码的VLSI设计，并详细介绍了基于宏块分割的变块自适应循环控制单元，针对存储器的读写问题提出了一种交织存取方式，针对分像素插值提出了一种基于H.264标准的插值运算电路。通过仿真及在H.264解码器中的实际应用和测试，证明该设计工作稳定，能够满足H.264标准基本框架下4CIF格式图片30fps（帧/秒）实时解码的要求。 | |
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