頭條 世界首款微处理器MP944被复活 7月27日，嵌入式系统专家亚当·泰勒使用FPGA（现场可编程门阵列）复刻F-14雄猫战斗机的中央大气数据计算机，将其装入3D打印的F-14模型中，成功控制后者的可变后掠翼系统。 该系统核心为MP944微处理器，1970年6月随F-14服役，比1971年11月问世的英特尔4004早近一年半，此前因军事保密1998年才解密，是世界首款微处理器，性能较英特尔4004快约8倍。亚当·泰勒基于Spartan 7的SoM模块复现了MP944全部六块芯片，目前该项目的全部代码和文档已公开在GitHub，供全球开发者查阅。 最新資訊 基于FPGA的数据采集系统设计 摘要：提出一种基于FPGA技术的多路模拟量、数字量采集与处理系统的设计方案，分析整个系统的结构，并讨论FPGA内部硬件资源的划分和软件的设计方案等。本设计方案外部电路结构简单可靠，特别适用于多路检测系统中，而 發表于：2011/8/22 DM642和CPLD外部中断的寄存器式键盘设计 摘要：介绍了一种采用DM642和CPLD相配合的扩展键盘方法。CPLD管理键盘电路中的芯片逻辑，DM642的外部中断监控按键的状态。简单阐述了键盘的分类，给出系统的硬件电路原理图，在CCS软件中调试程序方法。仿真结果表明， 發表于：2011/8/22 基于FPGA的DDS+DPLL跳频信号源设计 针对跳频通信系统有固有噪声的特点，结合DDS+DPLL高分辨率、高频率捷变速度的优点，并采用Altera公司的Quartus-Ⅱ_10．1软件进行设计综合，提出了一种新型的跳频信号源。结果表明，该设计中DPLL时钟可达到120 MHz，性能较高，而仅使用了30个LUT和18个触发器，占用资源很少。 發表于：2011/8/22 基于FPGA的交通灯系统控制设计 为了对交通灯系统进行精确控制，采用FPGA实验板，在QuartusⅡ软件环境下，分别实现脉冲发生模块、状态定时模块、交通灯显示模块、时间显示模块，进行仿真实验和硬件下载，获得的测试结果满足设计要求。由于采用了EDA技术，使数字系统设计的效率显著提高。 發表于：2011/8/22 IBM：新材料比硅快29倍可用于制造光速PC 英国曼彻斯特大学的科学家们正在研究一种只有一个原子厚的碳材料，可用于制造更精确的雷达系统，以及运行速度接近于光速的PC。 發表于：2011/8/21 基于Δ-Σ技术和FPGA的数据采集系统 为了改善传统数据采集系统运算能力差、分辨率低、可靠性低等缺点，结合Δ-Σ技术和FPGA，设计了一种多通道、高分辨率、宽动态范围的新型数据采集系统。提出了一种由Δ-Σ A/D转换芯片、高性能FPGA和DSP组成的数据采集系统方案及其硬件电路实现方法。系统利用A/D器件对信号进行滤波、放大、差分转换和模数转换，利用FPGA设计内部模块和时钟信号进行电路控制及实现数据缓存、数据传递等功能，由高速DSP芯片核心控制，对采样数据进行实时处理。系统能实现24位高分辨率、宽动态范围的信号数据采集与高速实时处理，可用于电压、电流、温度等参量的采集系统中。 發表于：2011/8/19 基于DSP+CPLD的新型智能监测系统设计与开发 将CPLD/FPGA和DSP技术的结合起来实现DSP器件系统的解决方案，为测控仪器向高层次智能化方向发展提供了充分的现实可行性。为实现对电力系统大型设备智能在线监测，本文以WSM2000 DSP智能电动机保护装置项目为背景，对一种DSP+CPLD新型的智能仪器结构进行了研究和设计。 發表于：2011/8/19 基于FPGA-NIOS的多功能留言机设计 设计基于DE2-70平台，利用Quartus II 9．0、NIOS II9．0 IDE、Modelsim SE 6．2b等设计工具，采用软硬件协同设计、自定义指令加速等设计技术，实现了声音图像采集播放等功能，并且支持用户的管理功能。设计针对家庭用户不仅实现了用户留言功能，并且具有近乎实时的留言提醒和电子钥匙等功能，具有实用价值。 發表于：2011/8/19 基于MCU CPLD变压器测试系统的设计与实现 本套测试系统用来测试铁路变压器的各种要求参数，包括原边空载电流、次边空载电压、次边带载电压电流，变压器绝缘电阻、原边电压频率，测量结果精度要求3%，在MCU和CPLD控制基础上对各种要求测试参数分别进行自动测试，系统满足操作简单可靠，提高效率，减少误差。本次开发综合考虑了MCU和CPLD的相互作用，采用了交流采样技术，认真考虑VHDL进程并行和CPLD的结构特点，并应用电路简化的几种技巧与方法，充分利用CPLD的硬件资源优化电路，实现系统对稳定性，精确度等方面的要求。 發表于：2011/8/19 基于Verilog HDL的CMOS图像敏感器驱动电路 使用Verilog语言设计时序逻辑具有很高的效率。结合CMOS敏感器特性可以方便地开发出驱动时序电路。但必须对CMOS图像敏感器的信号分析准确，正确分离那些独立的信号和共用的信号，用时序逻辑设计驱动信号，用组合逻辑实现不同采集过程时间上的分离。布线延迟是必须考虑的，采用流水线技术可以预测延迟，保证信号的正确性。虽然文中并未给出像素ADC输出的存储电路，但实际上直接使用TriAdc信号作为SRAM的片选，ClaAdc的低电平作为写信号，SRAM的地址在ClkAdc的上升沿增加、下降沿写入。这样就可以完成图像数据的存储。以上Verilog程序在FLEXl0kl0上布线实现。经示波器观察逻辑正确，CMOS敏感器正常工作。 發表于：2011/8/19 <…359360361362363364365366367368…>
